確定IP技術發布的日期有時是一項挑戰，尤其是英國處理器內核IP設計商 ARM。不過有證據可查的是第一款Arm內核處理器是在1985年4月26日在英國劍橋的Acorn上流片的，我們暫且將這個時間作為Arm真正進入IC設計領域的原點。ARM1是Acorn繼BBC Micro家用電腦成功之后自主開發的處理器。它由Sophie Wilson和Steve Furber開發。當日這顆處理器流片前在設計和制造方面已經進行了好幾個月的開發，而且硅片最后花了好幾個月才回到劍橋。 “它的設計制造成本低廉，由于設計對微處理器的
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Arm IP
在可編程邏輯器件領域，基于SRAM的FPGA經常被誤解。這些FPGA具有極高的靈活性和可重新配置特性，是從消費電子到航空航天等各類應用的理想選擇。此外，基于SRAM的FPGA還能帶來高性能和低延遲，非常適合實時數據處理和高速通信等要求苛刻的任務。一個常見的誤解是，基于SRAM的FPGA會因啟動時間較長而不堪負荷。通常的說法是，由于其配置數據存儲在片外，特別是在加密和需要驗證的情況下，將這些信息加載到FPGA的過程就成了瓶頸。然而，對于許多基于SRAM的現代FPGA來說，這種觀點并不成立，萊迪思Avant?
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SRAM FPGA 安全啟動機制 萊迪思 Lattice
雖然是EDA公司收購IC設計IP，但此次收購可能會在整個競爭格局中產生連鎖反應。Cadence強化一站式服務和EDA工具護城河，而Arm轉向更高利潤的芯片設計。
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Artisan Arm Cadence IP
近期，高云代理商聯詮國際聯合合作伙伴DepEye（深目微）共同推出?MIPI CPHY轉DPHY (C2D)透傳模塊：DEGC2DV60，功能基于高云GW5AT-LV60 FPGA實現，該產品適用于需要從?MIPI CPHY RX 橋接到 MIPI DPHY TX?的應用場景。DEGC2DV60 C2D透傳模塊高云Arora-V GW5AT-LV60FPGA特性高云 Arora V 系列的 GW5AT-LV60 FPGA，是其晨熙家族第5代產品，產品內部資源豐富，具有全新構架
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高云 Arora-V FPGA MIPI CPHY MIPI DPHY
告別英特爾Fab，告別OneAPI，能夠走自己路的Altera才能對得起自己曾經的百億身家。
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Altera 英特爾 FPGA
邁入4月，FPGA市場的重量級玩家Altera迎來了一次命運的轉折。英特爾新任CEO陳立武（Lip-Bu Tan）宣布與私募巨頭Silver Lake達成最終協議，戰略性出售其Altera業務51%的控股權。FPGA（Field Programmable Gate
Array，現場可編程門陣列）芯片，作為與CPU、GPU并駕齊驅的關鍵集成電路，其核心競爭力在于顛覆性的“現場可編程”與“可重構性”。想象一下，FPGA宛如一塊“變色龍”芯片，它的功能可以根據不同的“環境”（應用需求）而實時改變。亦或是把它
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FPGA altera
摘要本文介紹了一種在FPGA中實現的增強型正交頻分復用（OFDM）調制器設計，它使用了逆FFT模式的萊迪思快速傅立葉變換（FFT）Compiler IP核和萊迪思有限脈沖響應（FIR）濾波器IP核。該設計解決了在沒有主控制器的情況下生成復雜測試模式的常見難題，大大提高了無線鏈路測試的效率。通過直接測試模擬前端的JESD204B鏈路，OFDM調制器擺脫了對主機控制器的依賴，簡化了初始調試過程。該設計可直接在萊迪思FPGA核中實現，從而節省成本并縮短開發周期。該調制器的有效性驗證中使用了Avant-X70 V
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萊迪思半導體 iFFT FIR IP 5G OFDM
為了提供更好的用戶體驗，包括高質量的視頻傳輸、更新的筆記本電腦（例如最新的 AI PC）和其他前沿設備，都需要 5 納米及以下的先進節點 SoC，以達成出色的功耗、性能和面積（PPA）目標。然而，隨著技術發展到 5 納米以下的工藝節點，SoC 供應商面臨各種挑戰，例如平衡低功耗和低工作電壓（通常低于 1.2V）的需求。與此同時，市場也需要高分辨率相機、更快的幀率和 AI 驅動的計算，這就要求接口具有更高的數據傳輸速率和更強的抗電磁干擾（EMI）能力。隨著這些性能要求變得越來越復雜，市場亟需創新的解決方案來
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Cadencee USB2V2 IP
近日，全球FPGA 創新技術領導者 Altera 宣布， Agilex? 7 M 系列FPGA正式量產出貨，這是現階段業界領先的集成高帶寬存儲器，并支持 DDR5 和 LPDDR5 存儲器技術的高端、高密度 FPGA。Agilex? 7 M 系列 FPGA 集成超過 380 萬個邏輯元件，并針對 AI、數據中心、下一代防火墻、5G 通信基礎設施及 8K 廣播設備等對高性能、高內存帶寬有較高需求的應用進行了專門優化。隨著AI、云計算和流媒體的高速發展，數據量也在呈指數級增長，因此，用戶對更高內存帶寬、更大容
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Altera Agilex FPGA 內存帶寬
創意2日宣布，自主研發的HBM4控制器與PHY IP完成投片，采用臺積電最先進N3P制程技術，并結合CoWoS-R先進封裝，成為業界首個實現12 Gbps數據傳輸速率之HBM4解決方案，為AI與高效能運算（HPC）應用樹立全新里程碑。HBM4 IP以創新中間層（Interposer）布局設計優化信號完整性（SI）與電源完整性（PI），確保在CoWoS系列封裝技術下穩定運行于高速模式。 創意指出，相較前代HBM3，HBM4 PHY（實體層）效能顯著提升，帶寬提升2.5倍，滿足巨量數據傳輸需求、功耗效率提升1
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創意 HBM4 IP 臺積電 N3P
Microchip Technology Inc.（微芯科技公司）的 PolarFire?片上系統（SoC）FPGA 已獲得汽車電子委員會 AEC-Q100 認證。AEC-Q 標準是集成電路的指南，通過壓力測試來衡量汽車電子元件的可靠性。通過 AEC-Q100 認證的器件都經過嚴格的測試，能夠承受汽車應用中的極端條件。PolarFire SoC FPGA已通過汽車行業1級溫度認證，支持-40°C至125°C工作范圍。PolarFire SoC FPGA 采用嵌入式 64 位四核 RISC-V? 架構，能夠
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Microchip FPGA
近日，一站式定制芯片及IP供應商——燦芯半導體（上海）股份有限公司宣布推出基于28HKD?0.9V/2.5V?平臺的DDR3/4, LPDDR3/4?Combo?IP?。該IP具備廣泛的協議兼容性，支持DDR3, DDR3L, DDR4和LPDDR3, LPDDR4協議，數據傳輸速率最高可達2667Mbps，并支持X16/X32/X64等多種數據位寬應用。燦芯半導體此次發布的DDR3/4,?LPDDR3/4 Combo IP集成高性能DDR&nb
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燦芯半導體 DDR3/4 LPDDR3/4 Combo IP
技術發展日新月異，為應對功耗和散熱挑戰，改善應用性能，FPGA、處理器、DSP和ASIC等數字計算器件的內核電壓逐漸降低。同時，這也導致內核電源容差變得更小，工作電壓范圍變窄。大多數開關穩壓器并非完美無缺，但內核電壓降低的趨勢要求電源供應必須非常精確，以確保電路正常運行1。窗口電壓監控器有助于確保器件在適當的內核電壓水平下運行，但閾值精度是使可用電源窗口最大化的重要因素2。 本文討論如何利用高精度窗口電壓監控器來使電源輸出最大化。通過改善器件內核電壓的可用電源窗口，確保器件在有效的工作電源范圍內運行。 簡
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202504 FPGA 窗口監控器 電源輸出 ADI
2024年12月，隨著“下一代小型FPGA平臺”Nexus? 2和基于該平臺的首個器件系列Certus?-N2通用FPGA的面世，萊迪思(Lattice)公司在小型FPGA領域的領先地位再次得到強化。所謂“小型FPGA平臺”，通常是指邏輯密度低于200K SLC(系統邏輯單元)的FPGA。而之所以被稱之為“下一代”，則是指Nexus 2在“先進的互連”、“優化的功耗和性能”和“領先的安全性能”三方面做出的重大改進。根據規劃，Nexus 2平臺目前推出了3個產品系列：通用FPGA Certus、視頻互連FP
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萊迪思 小型FPGA Certus FPGA 邊緣網絡
2024年，全球半導體行業發展面臨著更加復雜的局面——整體市場增長步伐放緩，工業、汽車、通信等傳統市場增長動力不足，AI技術相關領域異軍突起，展現出強勁的發展動能。在這樣的大環境下，萊迪思半導體在挑戰中尋求突破，取得了一系列可圈可點的成果。作為萊迪思的重要營收來源，覆蓋多個應用領域的工業市場增長顯著，為公司的發展提供了穩定的支撐。汽車市場盡管在2024年處于去庫存階段，但新能源汽車領域的發展符合預期。特別是在中國市場，萊迪思在智能駕艙等多個細分領域，與眾多國內新能源汽車廠商及Tier-1供應商建立了緊密的
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萊迪思 Nexus 2 FPGA
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